ywh
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4261f3693f
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feat(plsr): 接入XDM物理输入并闭环P/D末脉冲精度
- 接入XDM-60T4-E真实X输入扫描和X/M/HM独立位数据源
- 新增P19 Y到X端子回环自测,覆盖WAIT、EXT及正负硬限位
- 将ACT/EXT路径动作延迟到PULSE/DIR自然下降沿后执行
- 修复100kHz目标停止时的末脉冲截断和额外脉冲
- 优化TIM11/TIM14软件计数回退的成对UIF快照处理
- 完善长稳脚本的RTU T3.5坏CRC注入和实时进度显示
- 补充XDM硬件资料、IO映射、方案说明和完整测试报告
Tests:
- Host: 8 suites, 4932 checks PASS
- IAR Modbus: 0 errors, 0 warnings
- P14/P16: Y0~Y3各严格200000脉冲,实时预算全部通过
- P12/P13/P15: PASS
- Dual AB independent/simultaneous/dynamic: PASS
- P19 WAIT/EXT/正负硬限位及电气扫描: PASS
- HSD/SFD正常持久化板测: PASS
- P18 60秒、1800秒、坏CRC、断线重连及组合压力: PASS
Remaining:
- USB CDC并发长稳暂缓
- 目标板破坏性CRC回退待测
- HM掉电保持介质和语义待确定
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1 mês atrás |
ywh
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f96f713e09
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P14/P15/P16 批次合并:硬件计数、软限位高频采样、性能遥测与真机测试体系
P14 硬件计数与四轴 100kHz 压力:
- TIM9/TIM12 硬件计数接入(Q0/Q2、Q1/Q3 共享,16 位溢出扩展 counterBlockPulses,目标脉冲 CC1IF 判定)
- 计数资源租约与软件回退(Q2/Q3 走源 UIF),counter_stress 脚本 + 规格文档
P15 软限位边界:
- 制动距离改用真实硬件输出频率,2000Hz 高频采样提前 1 脉冲进入减速
- 四轴正/负 500/2000Hz 矩阵测试(验收 ±1 脉冲),soft_limit_matrix 脚本
P16 性能遥测:
- PlsrProcess/TIM6/输出 ISR/计数 ISR 最坏执行时间遥测(DWT cycles + 分段峰值)
- performance_test 脚本 + 规格文档(全部预算 PASS)
其余:
- Modbus 命令扩展:SAVE/LOAD_CONFIG 持久化命令、错误码 5/6、RESET_ERROR
- Flash 双槽 CRC+代数持久化(SFD900~1419,SAVE/LOAD 已接命令口)
- CW/CCW 段尾停止机制(cwStopPending,物理下降沿停止)
- AB 启动预热机制(abStartupPriming,首次启动 ISR 内释放引脚)
- USB CDC 运行时诊断(Rx 重装失败计数等)
- 上电自测改由 plsr_build_config.h 宏开关控制
- 新增真机测试脚本/文档:AB_STRESS、BIT_INPUT、LONG_STRESS、PERSISTENCE_BOARD
- 交接提示词与问题总清单(2026-08-10)
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1 mês atrás |
ywh
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c776438bcd
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P5 软限位保护 + 受控停止落地:限位提前减速真机验证 + 已知问题清单
本批完成内容:
软限位保护(P5):
- profile 新增受控停止入口 PlsrProfileRequestStop:目标频率/终止
频率置 0,按减速斜率平滑减速至停(无斜率时直接停止)。
- 软限位判定接入运动循环:位置到达限位前按减速距离提前触发
受控停止,避免撞击限位后急停。
- 自测新增 PlsrProtectionSelfTestQueue:Q0 脉冲 + Q4 方向,
目标 +10000 脉冲、正软限位 +500、1000Hz、减速 100ms、
方向延时 10ms(SFD900 软限位使能、SFD912/915 端子配置)。
- main.c 上电自测入口切换为保护测试(验证后可删除)。
文档:
- 新增《已知问题清单_2026-08-09.md》:记录 AB 启动边沿
(7501)与软限位边界精度(502)两个未关闭问题及根因方向。
上板验证(逻辑分析仪实测):
- 恒定 1000Hz 输出 460 脉冲后进入减速段(84.5ms 平滑减速
至 134Hz),共 502 个脉冲停止——验收 499~501,**超停 1~2
个脉冲**(触发点晚 ~9 个),停止后零残余边沿、无毛刺,
Q4 方向正向正常。
- 边界偏差已记录到已知问题清单,待定位(判定位置源/
提前量公式)。
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1 mês atrás |
ywh
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3d3662d27a
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fix(plsr): 校正首脉冲及减速尾段频率输出
- 修正 Q0~Q3 对应定时器的实际时钟频率
- 清除 UG 产生的 UIF,避免更新事件被误计为物理脉冲
- 增加共享中断 UIF 检查和硬件脉冲计数原子读取
- 在方向稳定期间暂停运动曲线推进
- 根据频率积分计算线性加速首脉冲周期
- 使用硬件实际计数同步运动曲线虚拟脉冲数
- 根据剩余脉冲数反算减速频率并补偿 ARR 预装载延迟
- 增加减速距离计算的 uint64_t 溢出保护
- 增加 Q0 定时器调试快照及相关主机测试
- 忽略并取消追踪本地截图和波形分析文件
验证:
- 实际上板波形验证通过
- 1308 项主机测试全部通过
- IAR 全量编译 0 错误、0 警告
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1 mês atrás |
ywh
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67971b3770
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HAL库新工程
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1 mês atrás |